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  1. ;***** THIS IS A MACHINE GENERATED FILE - DO NOT EDIT ********************
  2. ;***** Created: 2005-01-11 10:30 ******* Source: AT90S8515.xml ***********
  3. ;*************************************************************************
  4. ;* A P P L I C A T I O N   N O T E   F O R   T H E   A V R   F A M I L Y
  5. ;*
  6. ;* Number            : AVR000
  7. ;* File Name         : "8515def.inc"
  8. ;* Title             : Register/Bit Definitions for the AT90S8515
  9. ;* Date              : 2005-01-11
  10. ;* Version           : 2.14
  11. ;* Support E-mail    : avr@atmel.com
  12. ;* Target MCU        : AT90S8515
  13. ;*
  14. ;* DESCRIPTION
  15. ;* When including this file in the assembly program file, all I/O register
  16. ;* names and I/O register bit names appearing in the data book can be used.
  17. ;* In addition, the six registers forming the three data pointers X, Y and
  18. ;* Z have been assigned names XL - ZH. Highest RAM address for Internal
  19. ;* SRAM is also defined
  20. ;*
  21. ;* The Register names are represented by their hexadecimal address.
  22. ;*
  23. ;* The Register Bit names are represented by their bit number (0-7).
  24. ;*
  25. ;* Please observe the difference in using the bit names with instructions
  26. ;* such as "sbr"/"cbr" (set/clear bit in register) and "sbrs"/"sbrc"
  27. ;* (skip if bit in register set/cleared). The following example illustrates
  28. ;* this:
  29. ;*
  30. ;* in    r16,PORTB             ;read PORTB latch
  31. ;* sbr   r16,(1<<PB6)+(1<<PB5) ;set PB6 and PB5 (use masks, not bit#)
  32. ;* out   PORTB,r16             ;output to PORTB
  33. ;*
  34. ;* in    r16,TIFR              ;read the Timer Interrupt Flag Register
  35. ;* sbrc  r16,TOV0              ;test the overflow flag (use bit#)
  36. ;* rjmp  TOV0_is_set           ;jump if set
  37. ;* ...                         ;otherwise do something else
  38. ;*************************************************************************
  39.  
  40. #ifndef _8515DEF_INC_
  41. #define _8515DEF_INC_
  42.  
  43.  
  44. #pragma partinc 0
  45.  
  46. ; ***** SPECIFY DEVICE ***************************************************
  47. .device AT90S8515
  48. #pragma AVRPART ADMIN PART_NAME AT90S8515
  49. .equ    SIGNATURE_000   = 0x1e
  50. .equ    SIGNATURE_001   = 0x93
  51. .equ    SIGNATURE_002   = 0x01
  52.  
  53. #pragma AVRPART CORE CORE_VERSION V1
  54.  
  55.  
  56. ; ***** I/O REGISTER DEFINITIONS *****************************************
  57. ; NOTE:
  58. ; Definitions marked "MEMORY MAPPED"are extended I/O ports
  59. ; and cannot be used with IN/OUT instructions
  60. .equ    SREG    = 0x3f
  61. .equ    SPH     = 0x3e
  62. .equ    SPL     = 0x3d
  63. .equ    GIMSK   = 0x3b
  64. .equ    GIFR    = 0x3a
  65. .equ    TIMSK   = 0x39
  66. .equ    TIFR    = 0x38
  67. .equ    MCUCR   = 0x35
  68. .equ    TCCR0   = 0x33
  69. .equ    TCNT0   = 0x32
  70. .equ    TCCR1A  = 0x2f
  71. .equ    TCCR1B  = 0x2e
  72. .equ    TCNT1H  = 0x2d
  73. .equ    TCNT1L  = 0x2c
  74. .equ    OCR1AH  = 0x2b
  75. .equ    OCR1AL  = 0x2a
  76. .equ    OCR1BH  = 0x29
  77. .equ    OCR1BL  = 0x28
  78. .equ    ICR1H   = 0x25
  79. .equ    ICR1L   = 0x24
  80. .equ    WDTCR   = 0x21
  81. .equ    EEARH   = 0x1f
  82. .equ    EEARL   = 0x1e
  83. .equ    EEDR    = 0x1d
  84. .equ    EECR    = 0x1c
  85. .equ    PORTA   = 0x1b
  86. .equ    DDRA    = 0x1a
  87. .equ    PINA    = 0x19
  88. .equ    PORTB   = 0x18
  89. .equ    DDRB    = 0x17
  90. .equ    PINB    = 0x16
  91. .equ    PORTC   = 0x15
  92. .equ    DDRC    = 0x14
  93. .equ    PINC    = 0x13
  94. .equ    PORTD   = 0x12
  95. .equ    DDRD    = 0x11
  96. .equ    PIND    = 0x10
  97. .equ    SPDR    = 0x0f
  98. .equ    SPSR    = 0x0e
  99. .equ    SPCR    = 0x0d
  100. .equ    UDR     = 0x0c
  101. .equ    USR     = 0x0b
  102. .equ    UCR     = 0x0a
  103. .equ    UBRR    = 0x09
  104. .equ    ACSR    = 0x08
  105.  
  106.  
  107. ; ***** BIT DEFINITIONS **************************************************
  108.  
  109. ; ***** ANALOG_COMPARATOR ************
  110. ; ACSR - Analog Comparator Control And Status Register
  111. .equ    ACIS0   = 0     ; Analog Comparator Interrupt Mode Select bit 0
  112. .equ    ACIS1   = 1     ; Analog Comparator Interrupt Mode Select bit 1
  113. .equ    ACIC    = 2     ; Analog Comparator Input Capture Enable
  114. .equ    ACIE    = 3     ; Analog Comparator Interrupt Enable
  115. .equ    ACI     = 4     ; Analog Comparator Interrupt Flag
  116. .equ    ACO     = 5     ; Analog Comparator Output
  117. .equ    ACD     = 7     ; Analog Comparator Disable
  118.  
  119.  
  120. ; ***** SPI **************************
  121. ; SPDR - SPI Data Register
  122. .equ    SPDR0   = 0     ; SPI Data Register bit 0
  123. .equ    SPDR1   = 1     ; SPI Data Register bit 1
  124. .equ    SPDR2   = 2     ; SPI Data Register bit 2
  125. .equ    SPDR3   = 3     ; SPI Data Register bit 3
  126. .equ    SPDR4   = 4     ; SPI Data Register bit 4
  127. .equ    SPDR5   = 5     ; SPI Data Register bit 5
  128. .equ    SPDR6   = 6     ; SPI Data Register bit 6
  129. .equ    SPDR7   = 7     ; SPI Data Register bit 7
  130.  
  131. ; SPSR - SPI Status Register
  132. .equ    WCOL    = 6     ; Write Collision Flag
  133. .equ    SPIF    = 7     ; SPI Interrupt Flag
  134.  
  135. ; SPCR - SPI Control Register
  136. .equ    SPR0    = 0     ; SPI Clock Rate Select 0
  137. .equ    SPR1    = 1     ; SPI Clock Rate Select 1
  138. .equ    CPHA    = 2     ; Clock Phase
  139. .equ    CPOL    = 3     ; Clock polarity
  140. .equ    MSTR    = 4     ; Master/Slave Select
  141. .equ    DORD    = 5     ; Data Order
  142. .equ    SPE     = 6     ; SPI Enable
  143. .equ    SPIE    = 7     ; SPI Interrupt Enable
  144.  
  145.  
  146. ; ***** UART *************************
  147. ; UDR - UART I/O Data Register
  148. .equ    UDR0    = 0     ; UART I/O Data Register bit 0
  149. .equ    UDR1    = 1     ; UART I/O Data Register bit 1
  150. .equ    UDR2    = 2     ; UART I/O Data Register bit 2
  151. .equ    UDR3    = 3     ; UART I/O Data Register bit 3
  152. .equ    UDR4    = 4     ; UART I/O Data Register bit 4
  153. .equ    UDR5    = 5     ; UART I/O Data Register bit 5
  154. .equ    UDR6    = 6     ; UART I/O Data Register bit 6
  155. .equ    UDR7    = 7     ; UART I/O Data Register bit 7
  156.  
  157. ; USR - UART Status Register
  158. .equ    DOR     = 3     ; Data overRun
  159. .equ    FE      = 4     ; Framing Error
  160. .equ    UDRE    = 5     ; UART Data Register Empty
  161. .equ    TXC     = 6     ; UART Transmit Complete
  162. .equ    RXC     = 7     ; UART Receive Complete
  163.  
  164. ; UCR - UART Control Register
  165. .equ    TXB8    = 0     ; Transmit Data Bit 8
  166. .equ    RXB8    = 1     ; Receive Data Bit 8
  167. .equ    CHR9    = 2     ; 9-bit Characters
  168. .equ    TXEN    = 3     ; Transmitter Enable
  169. .equ    RXEN    = 4     ; Receiver Enable
  170. .equ    UDRIE   = 5     ; UART Data Register Empty Interrupt Enable
  171. .equ    TXCIE   = 6     ; TX Complete Interrupt Enable
  172. .equ    RXCIE   = 7     ; RX Complete Interrupt Enable
  173.  
  174. ; UBRR - UART BAUD Rate Register
  175. .equ    UBRR0   = 0     ; UART Baud Rate Register bit 0
  176. .equ    UBRR1   = 1     ; UART Baud Rate Register bit 1
  177. .equ    UBRR2   = 2     ; UART Baud Rate Register bit 2
  178. .equ    UBRR3   = 3     ; UART Baud Rate Register bit 3
  179. .equ    UBRR4   = 4     ; UART Baud Rate Register bit 4
  180. .equ    UBRR5   = 5     ; UART Baud Rate Register bit 5
  181. .equ    UBRR6   = 6     ; UART Baud Rate Register bit 6
  182. .equ    UBRR7   = 7     ; UART Baud Rate Register bit 7
  183.  
  184.  
  185. ; ***** EXTERNAL_INTERRUPT ***********
  186. ; GIMSK - General Interrupt Mask Register
  187. .equ    INT0    = 6     ; External Interrupt Request 0 Enable
  188. .equ    INT1    = 7     ; External Interrupt Request 1 Enable
  189.  
  190. ; GIFR - General Interrupt Flag register
  191. .equ    INTF0   = 6     ; External Interrupt Flag 0
  192. .equ    INTF1   = 7     ; External Interrupt Flag 1
  193.  
  194.  
  195. ; ***** PORTA ************************
  196. ; PORTA - Port A Data Register
  197. .equ    PORTA0  = 0     ; Port A Data Register bit 0
  198. .equ    PA0     = 0     ; For compatibility
  199. .equ    PORTA1  = 1     ; Port A Data Register bit 1
  200. .equ    PA1     = 1     ; For compatibility
  201. .equ    PORTA2  = 2     ; Port A Data Register bit 2
  202. .equ    PA2     = 2     ; For compatibility
  203. .equ    PORTA3  = 3     ; Port A Data Register bit 3
  204. .equ    PA3     = 3     ; For compatibility
  205. .equ    PORTA4  = 4     ; Port A Data Register bit 4
  206. .equ    PA4     = 4     ; For compatibility
  207. .equ    PORTA5  = 5     ; Port A Data Register bit 5
  208. .equ    PA5     = 5     ; For compatibility
  209. .equ    PORTA6  = 6     ; Port A Data Register bit 6
  210. .equ    PA6     = 6     ; For compatibility
  211. .equ    PORTA7  = 7     ; Port A Data Register bit 7
  212. .equ    PA7     = 7     ; For compatibility
  213.  
  214. ; DDRA - Port A Data Direction Register
  215. .equ    DDA0    = 0     ; Data Direction Register, Port A, bit 0
  216. .equ    DDA1    = 1     ; Data Direction Register, Port A, bit 1
  217. .equ    DDA2    = 2     ; Data Direction Register, Port A, bit 2
  218. .equ    DDA3    = 3     ; Data Direction Register, Port A, bit 3
  219. .equ    DDA4    = 4     ; Data Direction Register, Port A, bit 4
  220. .equ    DDA5    = 5     ; Data Direction Register, Port A, bit 5
  221. .equ    DDA6    = 6     ; Data Direction Register, Port A, bit 6
  222. .equ    DDA7    = 7     ; Data Direction Register, Port A, bit 7
  223.  
  224. ; PINA - Port A Input Pins
  225. .equ    PINA0   = 0     ; Input Pins, Port A bit 0
  226. .equ    PINA1   = 1     ; Input Pins, Port A bit 1
  227. .equ    PINA2   = 2     ; Input Pins, Port A bit 2
  228. .equ    PINA3   = 3     ; Input Pins, Port A bit 3
  229. .equ    PINA4   = 4     ; Input Pins, Port A bit 4
  230. .equ    PINA5   = 5     ; Input Pins, Port A bit 5
  231. .equ    PINA6   = 6     ; Input Pins, Port A bit 6
  232. .equ    PINA7   = 7     ; Input Pins, Port A bit 7
  233.  
  234.  
  235. ; ***** PORTB ************************
  236. ; PORTB - Port B Data Register
  237. .equ    PORTB0  = 0     ; Port B Data Register bit 0
  238. .equ    PB0     = 0     ; For compatibility
  239. .equ    PORTB1  = 1     ; Port B Data Register bit 1
  240. .equ    PB1     = 1     ; For compatibility
  241. .equ    PORTB2  = 2     ; Port B Data Register bit 2
  242. .equ    PB2     = 2     ; For compatibility
  243. .equ    PORTB3  = 3     ; Port B Data Register bit 3
  244. .equ    PB3     = 3     ; For compatibility
  245. .equ    PORTB4  = 4     ; Port B Data Register bit 4
  246. .equ    PB4     = 4     ; For compatibility
  247. .equ    PORTB5  = 5     ; Port B Data Register bit 5
  248. .equ    PB5     = 5     ; For compatibility
  249. .equ    PORTB6  = 6     ; Port B Data Register bit 6
  250. .equ    PB6     = 6     ; For compatibility
  251. .equ    PORTB7  = 7     ; Port B Data Register bit 7
  252. .equ    PB7     = 7     ; For compatibility
  253.  
  254. ; DDRB - Port B Data Direction Register
  255. .equ    DDB0    = 0     ; Port B Data Direction Register bit 0
  256. .equ    DDB1    = 1     ; Port B Data Direction Register bit 1
  257. .equ    DDB2    = 2     ; Port B Data Direction Register bit 2
  258. .equ    DDB3    = 3     ; Port B Data Direction Register bit 3
  259. .equ    DDB4    = 4     ; Port B Data Direction Register bit 4
  260. .equ    DDB5    = 5     ; Port B Data Direction Register bit 5
  261. .equ    DDB6    = 6     ; Port B Data Direction Register bit 6
  262. .equ    DDB7    = 7     ; Port B Data Direction Register bit 7
  263.  
  264. ; PINB - Port B Input Pins
  265. .equ    PINB0   = 0     ; Port B Input Pins bit 0
  266. .equ    PINB1   = 1     ; Port B Input Pins bit 1
  267. .equ    PINB2   = 2     ; Port B Input Pins bit 2
  268. .equ    PINB3   = 3     ; Port B Input Pins bit 3
  269. .equ    PINB4   = 4     ; Port B Input Pins bit 4
  270. .equ    PINB5   = 5     ; Port B Input Pins bit 5
  271. .equ    PINB6   = 6     ; Port B Input Pins bit 6
  272. .equ    PINB7   = 7     ; Port B Input Pins bit 7
  273.  
  274.  
  275. ; ***** PORTC ************************
  276. ; PORTC - Port C Data Register
  277. .equ    PORTC0  = 0     ; Port C Data Register bit 0
  278. .equ    PC0     = 0     ; For compatibility
  279. .equ    PORTC1  = 1     ; Port C Data Register bit 1
  280. .equ    PC1     = 1     ; For compatibility
  281. .equ    PORTC2  = 2     ; Port C Data Register bit 2
  282. .equ    PC2     = 2     ; For compatibility
  283. .equ    PORTC3  = 3     ; Port C Data Register bit 3
  284. .equ    PC3     = 3     ; For compatibility
  285. .equ    PORTC4  = 4     ; Port C Data Register bit 4
  286. .equ    PC4     = 4     ; For compatibility
  287. .equ    PORTC5  = 5     ; Port C Data Register bit 5
  288. .equ    PC5     = 5     ; For compatibility
  289. .equ    PORTC6  = 6     ; Port C Data Register bit 6
  290. .equ    PC6     = 6     ; For compatibility
  291. .equ    PORTC7  = 7     ; Port C Data Register bit 7
  292. .equ    PC7     = 7     ; For compatibility
  293.  
  294. ; DDRC - Port C Data Direction Register
  295. .equ    DDC0    = 0     ; Port C Data Direction Register bit 0
  296. .equ    DDC1    = 1     ; Port C Data Direction Register bit 1
  297. .equ    DDC2    = 2     ; Port C Data Direction Register bit 2
  298. .equ    DDC3    = 3     ; Port C Data Direction Register bit 3
  299. .equ    DDC4    = 4     ; Port C Data Direction Register bit 4
  300. .equ    DDC5    = 5     ; Port C Data Direction Register bit 5
  301. .equ    DDC6    = 6     ; Port C Data Direction Register bit 6
  302. .equ    DDC7    = 7     ; Port C Data Direction Register bit 7
  303.  
  304. ; PINC - Port C Input Pins
  305. .equ    PINC0   = 0     ; Port C Input Pins bit 0
  306. .equ    PINC1   = 1     ; Port C Input Pins bit 1
  307. .equ    PINC2   = 2     ; Port C Input Pins bit 2
  308. .equ    PINC3   = 3     ; Port C Input Pins bit 3
  309. .equ    PINC4   = 4     ; Port C Input Pins bit 4
  310. .equ    PINC5   = 5     ; Port C Input Pins bit 5
  311. .equ    PINC6   = 6     ; Port C Input Pins bit 6
  312. .equ    PINC7   = 7     ; Port C Input Pins bit 7
  313.  
  314.  
  315. ; ***** PORTD ************************
  316. ; PORTD - Port D Data Register
  317. .equ    PORTD0  = 0     ; Port D Data Register bit 0
  318. .equ    PD0     = 0     ; For compatibility
  319. .equ    PORTD1  = 1     ; Port D Data Register bit 1
  320. .equ    PD1     = 1     ; For compatibility
  321. .equ    PORTD2  = 2     ; Port D Data Register bit 2
  322. .equ    PD2     = 2     ; For compatibility
  323. .equ    PORTD3  = 3     ; Port D Data Register bit 3
  324. .equ    PD3     = 3     ; For compatibility
  325. .equ    PORTD4  = 4     ; Port D Data Register bit 4
  326. .equ    PD4     = 4     ; For compatibility
  327. .equ    PORTD5  = 5     ; Port D Data Register bit 5
  328. .equ    PD5     = 5     ; For compatibility
  329. .equ    PORTD6  = 6     ; Port D Data Register bit 6
  330. .equ    PD6     = 6     ; For compatibility
  331. .equ    PORTD7  = 7     ; Port D Data Register bit 7
  332. .equ    PD7     = 7     ; For compatibility
  333.  
  334. ; DDRD - Port D Data Direction Register
  335. .equ    DDD0    = 0     ; Port D Data Direction Register bit 0
  336. .equ    DDD1    = 1     ; Port D Data Direction Register bit 1
  337. .equ    DDD2    = 2     ; Port D Data Direction Register bit 2
  338. .equ    DDD3    = 3     ; Port D Data Direction Register bit 3
  339. .equ    DDD4    = 4     ; Port D Data Direction Register bit 4
  340. .equ    DDD5    = 5     ; Port D Data Direction Register bit 5
  341. .equ    DDD6    = 6     ; Port D Data Direction Register bit 6
  342. .equ    DDD7    = 7     ; Port D Data Direction Register bit 7
  343.  
  344. ; PIND - Port D Input Pins
  345. .equ    PIND0   = 0     ; Port D Input Pins bit 0
  346. .equ    PIND1   = 1     ; Port D Input Pins bit 1
  347. .equ    PIND2   = 2     ; Port D Input Pins bit 2
  348. .equ    PIND3   = 3     ; Port D Input Pins bit 3
  349. .equ    PIND4   = 4     ; Port D Input Pins bit 4
  350. .equ    PIND5   = 5     ; Port D Input Pins bit 5
  351. .equ    PIND6   = 6     ; Port D Input Pins bit 6
  352. .equ    PIND7   = 7     ; Port D Input Pins bit 7
  353.  
  354.  
  355. ; ***** TIMER_COUNTER_1 **************
  356. ; TIMSK - Timer/Counter Interrupt Mask Register
  357. .equ    TICIE1  = 3     ; Timer/Counter1 Input Capture Interrupt Enable
  358. .equ    OCIE1B  = 5     ; Timer/Counter1 Output CompareB Match Interrupt Enable
  359. .equ    OCIE1A  = 6     ; Timer/Counter1 Output CompareA Match Interrupt Enable
  360. .equ    TOIE1   = 7     ; Timer/Counter1 Overflow Interrupt Enable
  361.  
  362. ; TIFR - Timer/Counter Interrupt Flag register
  363. .equ    ICF1    = 3     ; Input Capture Flag 1
  364. .equ    OCF1B   = 5     ; Output Compare Flag 1B
  365. .equ    OCF1A   = 6     ; Output Compare Flag 1A
  366. .equ    TOV1    = 7     ; Timer/Counter1 Overflow Flag
  367.  
  368. ; TCCR1A - Timer/Counter1 Control Register A
  369. .equ    PWM10   = 0     ; Pulse Width Modulator Select Bit 0
  370. .equ    PWM11   = 1     ; Pulse Width Modulator Select Bit 1
  371. .equ    COM1B0  = 4     ; Compare Output Mode 1B, bit 0
  372. .equ    COM1B1  = 5     ; Compare Output Mode 1B, bit 1
  373. .equ    COM1A0  = 6     ; Compare Ouput Mode 1A, bit 0
  374. .equ    COM1A1  = 7     ; Compare Output Mode 1A, bit 1
  375.  
  376. ; TCCR1B - Timer/Counter1 Control Register B
  377. .equ    CS10    = 0     ; Clock Select1 bit 0
  378. .equ    CS11    = 1     ; Clock Select1 bit 1
  379. .equ    CS12    = 2     ; Clock Select1 bit 2
  380. .equ    CTC1    = 3     ; Clear Timer/Counter1 on Compare Match
  381. .equ    ICES1   = 6     ; Input Capture 1 Edge Select
  382. .equ    ICNC1   = 7     ; Input Capture 1 Noise Canceler
  383.  
  384.  
  385. ; ***** TIMER_COUNTER_0 **************
  386. ; TIMSK - Timer/Counter Interrupt Mask Register
  387. .equ    TOIE0   = 1     ; Timer/Counter0 Overflow Interrupt Enable
  388.  
  389. ; TIFR - Timer/Counter Interrupt Flag register
  390. .equ    TOV0    = 1     ; Timer/Counter0 Overflow Flag
  391.  
  392. ; TCCR0 - Timer/Counter0 Control Register
  393. .equ    CS00    = 0     ; Clock Select0 bit 0
  394. .equ    CS01    = 1     ; Clock Select0 bit 1
  395. .equ    CS02    = 2     ; Clock Select0 bit 2
  396.  
  397. ; TCNT0 - Timer Counter 0
  398. .equ    TCNT00  = 0     ; Timer Counter 0 bit 0
  399. .equ    TCNT01  = 1     ; Timer Counter 0 bit 1
  400. .equ    TCNT02  = 2     ; Timer Counter 0 bit 2
  401. .equ    TCNT03  = 3     ; Timer Counter 0 bit 3
  402. .equ    TCNT04  = 4     ; Timer Counter 0 bit 4
  403. .equ    TCNT05  = 5     ; Timer Counter 0 bit 5
  404. .equ    TCNT06  = 6     ; Timer Counter 0 bit 6
  405. .equ    TCNT07  = 7     ; Timer Counter 0 bit 7
  406.  
  407.  
  408. ; ***** WATCHDOG *********************
  409. ; WDTCR - Watchdog Timer Control Register
  410. .equ    WDP0    = 0     ; Watch Dog Timer Prescaler bit 0
  411. .equ    WDP1    = 1     ; Watch Dog Timer Prescaler bit 1
  412. .equ    WDP2    = 2     ; Watch Dog Timer Prescaler bit 2
  413. .equ    WDE     = 3     ; Watch Dog Enable
  414. .equ    WDTOE   = 4     ; RW
  415. .equ    WDDE    = WDTOE ; For compatibility
  416.  
  417.  
  418. ; ***** CPU **************************
  419. ; SREG - Status Register
  420. .equ    SREG_C  = 0     ; Carry Flag
  421. .equ    SREG_Z  = 1     ; Zero Flag
  422. .equ    SREG_N  = 2     ; Negative Flag
  423. .equ    SREG_V  = 3     ; Two's Complement Overflow Flag
  424. .equ    SREG_S  = 4     ; Sign Bit
  425. .equ    SREG_H  = 5     ; Half Carry Flag
  426. .equ    SREG_T  = 6     ; Bit Copy Storage
  427. .equ    SREG_I  = 7     ; Global Interrupt Enable
  428.  
  429. ; MCUCR - MCU Control Register
  430. .equ    ISC00   = 0     ; Interrupt Sense Control 0 bit 0
  431. .equ    ISC01   = 1     ; Interrupt Sense Control 0 bit 1
  432. .equ    ISC10   = 2     ; Interrupt Sense Control 1 bit 0
  433. .equ    ISC11   = 3     ; Interrupt Sense Control 1 bit 1
  434. .equ    SM      = 4     ; Sleep Mode
  435. .equ    SE      = 5     ; Sleep Enable
  436. .equ    SRW     = 6     ; External SRAM Wait State
  437. .equ    SRE     = 7     ; External SRAM Enable
  438.  
  439.  
  440. ; ***** EEPROM ***********************
  441. ; EEDR - EEPROM Data Register
  442. .equ    EEDR0   = 0     ; EEPROM Data Register bit 0
  443. .equ    EEDR1   = 1     ; EEPROM Data Register bit 1
  444. .equ    EEDR2   = 2     ; EEPROM Data Register bit 2
  445. .equ    EEDR3   = 3     ; EEPROM Data Register bit 3
  446. .equ    EEDR4   = 4     ; EEPROM Data Register bit 4
  447. .equ    EEDR5   = 5     ; EEPROM Data Register bit 5
  448. .equ    EEDR6   = 6     ; EEPROM Data Register bit 6
  449. .equ    EEDR7   = 7     ; EEPROM Data Register bit 7
  450.  
  451. ; EECR - EEPROM Control Register
  452. .equ    EERE    = 0     ; EEPROM Read Enable
  453. .equ    EEWE    = 1     ; EEPROM Write Enable
  454. .equ    EEMWE   = 2     ; EEPROM Master Write Enable
  455.  
  456.  
  457.  
  458. ; ***** LOCKSBITS ********************************************************
  459. .equ    LB1     = 0     ; Lockbit
  460. .equ    LB2     = 1     ; Lockbit
  461.  
  462.  
  463. ; ***** FUSES ************************************************************
  464. ; LOW fuse bits
  465. .equ    SPIEN   = 1     ; Serial Program Downloading Enabled
  466. .equ    FSTRT   = 2     ; Short Start-up time selected
  467.  
  468.  
  469.  
  470. ; ***** CPU REGISTER DEFINITIONS *****************************************
  471. .def    XH      = r27
  472. .def    XL      = r26
  473. .def    YH      = r29
  474. .def    YL      = r28
  475. .def    ZH      = r31
  476. .def    ZL      = r30
  477.  
  478.  
  479.  
  480. ; ***** DATA MEMORY DECLARATIONS *****************************************
  481. .equ    FLASHEND        = 0x0fff        ; Note: Word address
  482. .equ    IOEND   = 0x003f
  483. .equ    SRAM_START      = 0x0060
  484. .equ    SRAM_SIZE       = 512
  485. .equ    RAMEND  = 0x025f
  486. .equ    XRAMEND = 0xffff
  487. .equ    E2END   = 0x01ff
  488. .equ    EEPROMEND       = 0x01ff
  489. .equ    EEADRBITS       = 9
  490. #pragma AVRPART MEMORY PROG_FLASH 8192
  491. #pragma AVRPART MEMORY EEPROM 512
  492. #pragma AVRPART MEMORY INT_SRAM SIZE 512
  493. #pragma AVRPART MEMORY INT_SRAM START_ADDR 0x60
  494.  
  495.  
  496.  
  497.  
  498.  
  499. ; ***** INTERRUPT VECTORS ************************************************
  500. .equ    INT0addr        = 0x0001        ; External Interrupt Request 0
  501. .equ    INT1addr        = 0x0002        ; External Interrupt Request 1
  502. .equ    ICP1addr        = 0x0003        ; Timer/Counter Capture Event
  503. .equ    OC1Aaddr        = 0x0004        ; Timer/Counter1 Compare Match A
  504. .equ    OC1Baddr        = 0x0005        ; Timer/Counter1 Compare MatchB
  505. .equ    OVF1addr        = 0x0006        ; Timer/Counter1 Overflow
  506. .equ    OVF0addr        = 0x0007        ; Timer/Counter0 Overflow
  507. .equ    SPIaddr = 0x0008        ; Serial Transfer Complete
  508. .equ    URXCaddr        = 0x0009        ; UART, Rx Complete
  509. .equ    UDREaddr        = 0x000a        ; UART Data Register Empty
  510. .equ    UTXCaddr        = 0x000b        ; UART, Tx Complete
  511. .equ    ACIaddr = 0x000c        ; Analog Comparator
  512.  
  513. .equ    INT_VECTORS_SIZE        = 13    ; size in words
  514.  
  515. #pragma AVRPART CORE INSTRUCTIONS_NOT_SUPPORTED break
  516.  
  517. #endif  /* _8515DEF_INC_ */
  518.  
  519. ; ***** END OF FILE ******************************************************
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